FIADS.xpr

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<!-- Product Version: Vivado v2022.2 (64-bit)              -->
<!--                                                         -->
<!-- Copyright 1986-2022 Xilinx, Inc. All Rights Reserved.   -->

<Project Version="7" Minor="61" Path="D:/OneDrive - GeorgeDong/Coding/FPGA FinalDesign/FIADS/FIADS.xpr">
  <DefaultLaunch Dir="$PRUNDIR"/>
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    <Option Name="IPCachePermission" Val="write"/>
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  </Configuration>
  <FileSets Version="1" Minor="31">
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      </File>
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      </File>
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        <FileInfo>
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      </File>
      <File Path="$PSRCDIR/sources_1/imports/src/display_module.v">
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    <FileSet Name="constrs_1" Type="Constrs" RelSrcDir="$PSRCDIR/constrs_1" RelGenDir="$PGENDIR/constrs_1">
      <Filter Type="Constrs"/>
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          <Attr Name="ImportPath" Val="$PPRDIR/src/camera_ov7670.xdc"/>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="ConstrsType" Val="XDC"/>
      </Config>
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    <FileSet Name="utils_1" Type="Utils" RelSrcDir="$PSRCDIR/utils_1" RelGenDir="$PGENDIR/utils_1">
      <Filter Type="Utils"/>
      <Config>
        <Option Name="TopAutoSet" Val="TRUE"/>
      </Config>
    </FileSet>
    <FileSet Name="pll" Type="BlockSrcs" RelSrcDir="$PSRCDIR/pll" RelGenDir="$PGENDIR/pll">
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        <FileInfo>
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      </File>
      <Config>
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      </Config>
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    <FileSet Name="BRAM" Type="BlockSrcs" RelSrcDir="$PSRCDIR/BRAM" RelGenDir="$PGENDIR/BRAM">
      <File Path="$PSRCDIR/sources_1/ip/BRAM/BRAM.xci">
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        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="BRAM"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="top_module_test" Type="SimulationSrcs" RelSrcDir="$PSRCDIR/top_module_test" RelGenDir="$PGENDIR/top_module_test">
      <Filter Type="Srcs"/>
      <File Path="$PSRCDIR/sources_1/imports/src/FIADS.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="$PPRDIR/src/FIADS.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/top_module_test/imports/testbench/top_module_tb.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="$PPRDIR/testbench/top_module_tb.v"/>
          <Attr Name="ImportTime" Val="1687316952"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/top_module_test_behav.wcfg">
        <FileInfo>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="DesignMode" Val="RTL"/>
        <Option Name="TopModule" Val="top_module_test"/>
        <Option Name="TopLib" Val="xil_defaultlib"/>
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        <Option Name="PamDesignTestbench" Val=""/>
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      </Config>
    </FileSet>
    <FileSet Name="acq_module_test" Type="SimulationSrcs" RelSrcDir="$PSRCDIR/acq_module_test" RelGenDir="$PGENDIR/acq_module_test">
      <Filter Type="Srcs"/>
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        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/src/acquisition_module.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="$PPRDIR/src/acquisition_module.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/src/cam_config.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="$PPRDIR/src/cam_config.v"/>
          <Attr Name="ImportTime" Val="1687317496"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/acq_module_test/imports/testbench/acq_module_tb.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="$PPRDIR/testbench/acq_module_tb.v"/>
          <Attr Name="ImportTime" Val="1687354507"/>
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      </File>
      <File Path="$PPRDIR/acq_module_test_behav.wcfg">
        <FileInfo>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="DesignMode" Val="RTL"/>
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        <Option Name="TopLib" Val="xil_defaultlib"/>
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        <Option Name="TransportPathDelay" Val="0"/>
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        <Option Name="SelectedSimModel" Val="rtl"/>
        <Option Name="PamDesignTestbench" Val=""/>
        <Option Name="PamDutBypassFile" Val="xil_dut_bypass"/>
        <Option Name="PamSignalDriverFile" Val="xil_bypass_driver"/>
        <Option Name="PamPseudoTop" Val="pseudo_tb"/>
        <Option Name="SrcSet" Val="sources_1"/>
        <Option Name="XSimWcfgFile" Val="$PPRDIR/acq_module_test_behav.wcfg"/>
      </Config>
    </FileSet>
    <FileSet Name="disp_module_test" Type="SimulationSrcs" RelSrcDir="$PSRCDIR/disp_module_test" RelGenDir="$PGENDIR/disp_module_test">
      <Filter Type="Srcs"/>
      <File Path="$PSRCDIR/sources_1/imports/src/display_module.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="$PPRDIR/src/display_module.v"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/src/vga_display.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="$PPRDIR/src/vga_display.v"/>
          <Attr Name="ImportTime" Val="1687315762"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/sources_1/imports/src/vga_driver.v">
        <FileInfo>
          <Attr Name="ImportPath" Val="$PPRDIR/src/vga_driver.v"/>
          <Attr Name="ImportTime" Val="1687178180"/>
          <Attr Name="UsedIn" Val="synthesis"/>
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        </FileInfo>
      </File>
      <File Path="$PSRCDIR/disp_module_test/imports/testbench/disp_module_tb.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/disp_module_test_behav.wcfg">
        <FileInfo>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="DesignMode" Val="RTL"/>
        <Option Name="TopModule" Val="disp_module_test"/>
        <Option Name="TopLib" Val="xil_defaultlib"/>
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        <Option Name="TransportPathDelay" Val="0"/>
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        <Option Name="PamPseudoTop" Val="pseudo_tb"/>
        <Option Name="SrcSet" Val="sources_1"/>
        <Option Name="XSimWcfgFile" Val="$PPRDIR/disp_module_test_behav.wcfg"/>
      </Config>
    </FileSet>
  </FileSets>
  <Simulators>
    <Simulator Name="XSim">
      <Option Name="Description" Val="Vivado Simulator"/>
      <Option Name="CompiledLib" Val="0"/>
    </Simulator>
    <Simulator Name="ModelSim">
      <Option Name="Description" Val="ModelSim Simulator"/>
    </Simulator>
    <Simulator Name="Questa">
      <Option Name="Description" Val="Questa Advanced Simulator"/>
    </Simulator>
    <Simulator Name="Riviera">
      <Option Name="Description" Val="Riviera-PRO Simulator"/>
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    <Simulator Name="ActiveHDL">
      <Option Name="Description" Val="Active-HDL Simulator"/>
    </Simulator>
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  <Runs Version="1" Minor="19">
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      <Strategy Version="1" Minor="2">
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    <Run Id="BRAM_impl_1" Type="Ft2:EntireDesign" Part="xc7a100tcsg324-1" ConstrsSet="BRAM" Description="Default settings for Implementation." AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" SynthRun="BRAM_synth_1" IncludeInArchive="false" IsChild="false" GenFullBitstream="true" AutoIncrementalDir="$PSRCDIR/utils_1/imports/BRAM_impl_1" AutoRQSDir="$PSRCDIR/utils_1/imports/BRAM_impl_1">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Implementation Defaults" Flow="Vivado Implementation 2022"/>
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      <ReportStrategy Name="Vivado Implementation Default Reports" Flow="Vivado Implementation 2022"/>
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